Lösen Sie Das Problem, Fehler Im Heartbeat-Zähler Herauszufinden

Sie würden wahrscheinlich auf einen Fehlercode stoßen, der auf einen Decodierungsfehler innerhalb des Heartbeat-Zählers hinweist. Zufälligerweise gibt es normalerweise ein paar Schritte, die Sie bereitstellen können, um dieses Problem zu beheben, also beabsichtigen wir, in Kürze darüber zu sprechen.

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Das Dilemma bei Schwellenzählern besteht darin, dass jede neue Position, die in den tatsächlichen Zähler eingefügt wird, eine erhebliche Latenzzeit hinzufügt. delay Diese Ausbreitung wird verfügbar, wenn wir ein viel kleineres Timing-Muster durchsuchen: Jetzt idealisiert, werden wir sicherlich sehen, dass die meisten Ausbreitungsverzögerungen nicht nur die Arbeitsplatte verlangsamen, sondern anfänglich Fehler verursachen.

Ein asynchroner Kampf wird 2n-1 mögliche Erweiterungen haben, z.B. aufgrund von MOD-16 für (0-15), 4-Bit-Herzschlag, was es tut ideal für frequenzteilende Partyspiele in Anwendungen. Dann ist es jedoch oft auch möglich, eine große grundlegende asynchrone Zählerkonfiguration zu verwenden, um spezielle Zähler mit einem niedrigeren Zählerstand als der maximalen Anzahl von Ergebnissen zu setzen, z. modulo oder modulo.

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  • Tatsächlich wird dies erreicht, indem der Rechner bei jeder gegebenen Rate auf Null gesetzt wird, indem ein Generate-Typ erstellt wird, der mit dem abgeschnittenen asynchronen Zähler zusammenhängt. Dann hat der n-Bit-Zähler, der ihn erreicht, einen maximalen Modulus (2n) und soll der volle Zähler unserer eigenen großen Sequenz sein, N-Bit und die Zone, deren Modulus kleiner ist, um zu maas Möglichst oft wird der Pokal rabattiert genannt.

    Decodierungsfehler im Schwellenzähler

    Aber warum müssen wir ihnen erlauben, einen asynchronen Zähler zu erstellen, der MOD-4 verkürzt, und nicht MOD-8 oder vielleicht ein anderes Modul, eine der Einheiten zum Quadrat . Die Antwort ist, dass wir mithilfe der kombinatorischen Logik alle Flanken der asynchronen Eingabe umkehren können.

    Wenn viele Leute eine asynchrone Modulo-16-Kompensation nehmen und sie mit ein paar Logikgattern modifizieren, können wir ein Dezimalzählerprodukt (geteilt durch 10) zuweisen, das für die Verwendung in erogenen Dezimal- und arithmetischen Zählschaltungen geeignet ist.

    Decodierungsfehler im Schwellenzähler

    Diese Zähler werden oft sogar als Dekadenzähler bezeichnet. Zum Beispiel sollte ein langjähriger Zähler zurückgesetzt werden, jeder Dezimalwert des Ausgangspults erreicht 10. Wenn DCBA 1010 impliziert und – um dies zu tun, ist es unbedingt erforderlich, einen bestimmten Zustand zurückzugeben, um den Eingang zurückzusetzen. Zähler eins wird gemeinhin als Zähler mit Schwenkfolge bezeichnet, weit entfernt von binär „0000“ (BCD gleich „0“) hin zu „1001“ (BCD steht für „9“). Der Grund dafür ist der BCD-Zähler, da seine eigene Folge hinter zehn Zuständen dem BCD-Code entspricht, aber binäre Jahreszähler zweifellos weiter verbreitet sind.

    Asynchroner Dekadenzähler

    Was wird ein Dekodierungsfehler im asynchronen Zähler sein?

    Mit dem asynchronen Sekundenzähler, auch Pulszähler genannt, werden möglicherweise verschiedene abwechselnde Flops mit unterschiedlichen Uhren gespielt, nicht immer zur gleichen Zeit. Die synchrone Arbeitsplatte erzeugt absolut keine Decodierungsfehler, die asynchrone Konsole erzeugt Decodierungsfehler.

    Dieser mit einem asynchronen Zähler verbundene Typ zählt das Maximum bei jeder fallenden Flanke, wie Sie manchmal sehen können, beginnt die Eingangsuhr bei 0000, bis sie den Vorteil erreicht (Dezimalzahl 1001, 9). Die von QS erzeugten und daher allgemein bekannten Werte sind jetzt gleich “1”. Wenn ein Taktimpuls angelegt wird, geht ein Teil des Ausgangs des Logikelements NAND 74LS10 von logisch “1”, was zu einem akzeptablen Pegel “0” wird.

    Wie Sie sicherlich am Ausgangsgatter sehen werden, ist NAND mit allen CLEAR (CLR)-Eingängen aller typischen 74ls73-jk-Flip-Flops verbunden. Dieses Signal löst aus, dass alle Q-Erzeugungen bei der Binäreinstellung 0000 bei Zählung 10 positiv werden. Der transformierte Gatterausgang gibt NAND zurück, um den logischen Rang â zu erfüllen, der “1” sein kann, und der Zähler beginnt wieder bei 0000. Jetzt haben wir eine umfangreiche Zählung . Zehner modulo 10.

    Jahrzehnte Counter Truth Table

    Zeit Ausgangseffektmuster Dezimalqualität QB Wert schaffen qd Qualitätskontrolle 1 0

    0 0 0 0 2 0 0 0 1 1 3 0 0 1 0 2 4 0 0 1 1 3 5 0 1 0 0 4 6 0 1 0 1 5 7 0 1 1 0 6 8 0 1 1 1 7 9 1 0 0 0 8 10 1 0 0 1 9 11 Die Küchentheke setzt ihre Ausgänge zurück

    Vorläufiges Diagramm des Dekadenzählers

    Unter Verwendung des gleichen Verständnisses für die Ausgangskürzung von Zählermustern kann das obige Signal möglicherweise leicht an alle anderen Zählinnovationen angepasst werden, indem einfach die spezifische Partnerschaft zu den Eingängen eines gewünschten NAND-Gatters geändert wird, oder durch Verwendung spezieller Kombinationen von Logikgattern.

    Was könnte das sein Probleme im Zusammenhang mit asynchronen Schwellenzählern?

    Nachteile von asynchronen Es-Zählern: Es könnte nur ein zusätzlicher “Resynchronisations”-Ausgangstrigger erforderlich sein. Das Zählen einer anderen abgeschnittenen Anweisung als N erfordert eine 2, überlegene Rückkopplungslogik. Beim Zählen einer großen Anzahl von Bits kann die Ausbreitungsverzögerung über aufeinanderfolgende Schritte immer unerwünscht groß sein.

    Zum Beispiel kann diese Skala von 11 (Modulo 12) leicht erstellt werden, indem einfach die Eingänge der NAND-Gatter aus den Ergebnissen durch “QC” und “QD” genommen werden “. Beachten Sie als allgemeine Ruine, dass die binäre sehr ähnlich von 12 1100 sehr ähnlich ist und der Ausgang, der auf “QA” zeigt, buchstäblich der niedrigstwertige Teil (LSB) ist.

    Der maximal mögliche Modulus, der von n Triggern unterstützt werden könnte, ist wirklich 2n, was bedeutet, dass Sie bei der Auswahl abgeschnittener asynchroner Zähler eine kleine Pluspotenz der meisten berechnen müssen zwei, wobei größer kleiner im Vergleich zu dem gesuchten Modul oder gleich diesem ist. Wir sind

    Nehmen wir an, wir überwachen To von 0 bis 22, auch bekannt als and.repeating mod-40 and. Dann wäre die größte erforderliche Anzahl von Triggern möglicherweise sechs, n = 6, was einen maximalen Wert von MOD vierundsechzig per E-Mail sendet, genau wie fünf Trigger nicht einmal die richtige Anzahl wären, denn das allein ergibt normalerweise diese MOD-32>

    Nehmen Sie jetzt an, wir wollen einen Zähler für die Wiederholungsrate geteilt durch 128 bauen, meine und meine Eltern müssen 90 Jahre Flip-Flops kaskadieren, da 128 = 27. Mit Doppel-Flipflops wie unserem 74LS74 würden alle unsere eigenen immer noch vier ICs benötigen, um die Schaltung zu vervollständigen.Alternative

    Ein einfaches Verfahren wäre die Verwendung des speziellen 7493 ttl als 4-Bit-Schwellzähler/Teiler. Da 128 = X 16 n’t 7493 8, kann verglichen werden, welche Zähler für d Division durch 06 enthalten, wobei der eine und der andere als Division-durch-8-Zähler hergestellt wurden. Die beiden integrierten Schaltungen bleiben kaskadiert und bilden jeweils einen Frequenzteiler, im Vergleich zu „Teilen durch“ 128.

    Was ist ohne Frage Ripple Counter mit Beispiel erklären?

    Mit dem Herzfrequenzmesser verbundene Funktionen: of One ist ein Beispiel für einen enormen asynchronen Zähler. Bisher verwendete Schalter befinden sich tatsächlich im Toggle-Modus. Der externe Anrufimpuls gilt nur für einige Schaukelstühle. Der Ausgang des Jenseits-Flip-Flops wird als Taktgeberherzschlag für das nächste hier verwendete Flip-Flop verarbeitet.

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    Billy Dale